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1596b2beb0
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DRV8313兼容版
refactor(algorithm): 移除冗余头文件
移除不必要的stdint.h头文件引用，统一使用<cstdint>
refactor(sys): 清理系统级头文件依赖
移除未使用的头文件引用，统一整型类型定义，优化初始
化过程中的GPIO配置
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2026-01-24 01:50:39 +08:00 |
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d0198fdff7
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更新OTA功能，config独立成文件统一定义
refactor(build): 更新项目配置和链接器设置
- 修改GD32C103CB的ROM基地址和大小配置
- 更新系统时钟向量表偏移量设置
- 在cproject.yml中添加BIN输出格式支持
- 增加-O3优化级别和代码移除选项
- 更新csolution版本依赖
feat(device): 优化ADC采样和配置管理
- 将DengFOC依赖替换为FOC模块
- 从config.h引入配置常量
- 重命名FILTER_SIZE为ADC_FILTER_SIZE以提高清晰度
- 优化温度和电流采样滤波实现
refactor(algorithm): 简化FOC控制函数接口
- 为angle_control、velocity_control等函数移除不必要的参数
- 统一函数指针类型定义
- 优化电流计算函数的代码格式
- 调整PID控制器初始化参数
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2026-01-04 22:26:22 +08:00 |
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871e33e10f
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fix:修复任务调度不准确的问题，
feat:优化电流采样速率
feat:优化PIDramp效率
feat:优化角度采样效率
fix:回滚CAN打包逻辑
feat:去除timer3
feat(FOC): 优化帕克逆变换与克拉克逆变换计算方式
将原有的三角函数计算替换为查表法，提高运算效率。同时添加了 sqrt(3)/2 的预计算常量，并优化了电压限制部分的计算逻辑，减少重复运算。
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2025-11-23 18:31:47 +08:00 |
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a7a3805839
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feat(ADC): 电流采样支持负数
将 CURRENT_OFFSET 从 0 修改为 -1.60f 以校准电流采样偏差。
同时将 ADC 规则通道的采样时间从 55.5 周期调整为 28.5 周期，提高采样响应速度。
feat(timer): 新增 TIMER1 中断及 PWM 周期位置触发功能
新增 TIMER1_CH3 用于在 PWM 周期特定位置（如 50%）触发中断，并配置相关 NVIC 和中断处理逻辑。
修改 TIMER3 的定时周期注释与实际值一致，为 50 微秒。
重新组织 TIMER2 中断中的任务调度顺序，提升执行效率和逻辑清晰度。
refactor(main): 重构主循环任务处理顺序
调整 main.cpp 中任务执行顺序，确保高优先级任务及时处理。
将部分传感器更新任务移动至更合理的位置，保证数据同步性和控制实时性。
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2025-11-22 02:21:33 +08:00 |
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5d14731af5
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feat(FOC): 添加开关机功能并优化定时器配置
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2025-10-29 21:22:10 +08:00 |
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aaee40f36b
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FOC开环调试成功
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2025-10-16 21:43:34 +08:00 |
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cbb
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20fbb30067
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ADC已完成
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2025-10-02 02:52:07 +08:00 |
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cbb
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f2ae2669fa
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初始化
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2025-09-23 00:27:51 +08:00 |
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